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  • DG645 數(shù)字延時信號發(fā)生器

DG645 數(shù)字延時信號發(fā)生器

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  • 型號
  • 品牌
  • 所在地武漢市
  • 更新時間2025-03-01
  • 廠商性質(zhì)其他
  • 所在地區(qū)武漢市
  • 實名認證已認證
  • 產(chǎn)品數(shù)量24
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DG645數(shù)字延時信號發(fā)生器特點4個脈沖輸出8個延遲輸出(可選)小于25ps有效值抖動觸發(fā)速率高達10MHz精密速率發(fā)生器快速過渡時間烤箱化或Rb時基(可選)以太網(wǎng)、GPIB和RS-232概述DG645是一款多功能數(shù)字延遲/脈沖發(fā)生器,可在高達10MHz的重復(fù)頻率下提供精確定義的脈沖
DG645 數(shù)字延時信號發(fā)生器 產(chǎn)品詳情
DG645 數(shù)字延時信號發(fā)生器

 特點

4 個脈沖輸出

8 個延遲輸出(可選)

小于 25 ps 有效值抖動

觸發(fā)速率高達 10 MHz

精密速率發(fā)生器

快速過渡時間

烤箱化或 Rb 時基(可選)

以太網(wǎng)、GPIB 和 RS-232

 

概述                                                                                        

DG645 是一款多功能數(shù)字延遲/脈沖發(fā)生器,可在高達 10 MHz 的重復(fù)頻率下提供精確定義的脈沖。與舊設(shè)計相比,該儀器提供了多項改進 — 更低的抖動、更高的精度、更快的觸發(fā)速率和更多的輸出。DG645還具有以太網(wǎng)、GPIB和RS-232接口,用于儀器的計算機或網(wǎng)絡(luò)控制。

 

DG645數(shù)字延遲發(fā)生器

DG645 是一款多功能數(shù)字延遲/脈沖發(fā)生器,可在高達 10 MHz 的重復(fù)頻率下提供精確定義的脈沖。與舊設(shè)計相比,該儀器提供了多項改進 — 更低的抖動、更高的精度、更快的觸發(fā)速率和更多的輸出。DG645還具有以太網(wǎng)、GPIB和RS-232接口,用于儀器的計算機或網(wǎng)絡(luò)控制。

延遲發(fā)生器定時

 

時序圖

所有數(shù)字延遲發(fā)生器都通過計算快速時鐘(通常為100 MHz)的周期來測量時間間隔。大多數(shù)數(shù)字延遲發(fā)生器還具有較短的可編程模擬延遲,以實現(xiàn)比時鐘周期更精細的時間間隔。不幸的是,如果觸發(fā)與時鐘不同相,則可能會出現(xiàn)一個時序不確定性的時鐘周期(通常為10 ns)。

DG645 通過測量觸發(fā)相對于內(nèi)部時鐘的時序并補償模擬延遲來消除時序不確定性。這種方法可將抖動降低約100×并允許內(nèi)部速率發(fā)生器以任何速率工作,而不僅僅是時鐘頻率的子倍數(shù)。

觸發(fā)

DG645 具有多種觸發(fā)模式。周期抖動小于 100 ps 的內(nèi)部速率發(fā)生器可在 100 μHz 至 10 MHz 范圍內(nèi)設(shè)置,分辨率為 1 μHz。具有可調(diào)閾值和斜率的外部觸發(fā)輸入可以觸發(fā)定時周期、突發(fā)周期或單次觸發(fā)。一鍵觸發(fā)單次射擊。線路觸發(fā)器與交流電源同步工作。后面板觸發(fā)抑制輸入可以在定時周期內(nèi)禁用觸發(fā)器或任何脈沖輸出。

DG645 通過觸發(fā)抑制和預(yù)縮放功能支持許多復(fù)雜的觸發(fā)要求。

觸發(fā)器延遲設(shè)置連續(xù)觸發(fā)之間的最短時間。如果應(yīng)用程序中的觸發(fā)事件產(chǎn)生顯著的噪聲瞬變,在生成下一個觸發(fā)器之前需要時間衰減,這將非常有用。觸發(fā)保持也可用于以輸入觸發(fā)速率的子倍數(shù)觸發(fā)DG645。

 

前面板輸出

觸發(fā)預(yù)縮放使DG645能夠以更快的信號源同步觸發(fā),但觸發(fā)頻率是原始觸發(fā)頻率的子倍數(shù)。例如,DG645 可以以 1 kHz 的頻率觸發(fā),但可以通過將觸發(fā)輸入預(yù)縮放 80,80 來與以 000 MHz 運行的鎖模激光器同步。此外,DG645還為每個前面板輸出包含一個單獨的預(yù)分頻器,使每個輸出能夠以觸發(fā)速率的子倍數(shù)運行。

前面板輸出

有五個前面板輸出:T0、AB、CD、EF 和 GH。The T0輸出在定時周期內(nèi)置位。T的前緣0是零時間參考。編程延遲(A、B、C、D、E、F、G 和 H)設(shè)置為 0 s 至 2000 s,分辨率為 5 ps,以控制四個脈沖輸出的前沿和后沿的時序。

每個前面板輸出可以驅(qū)動 50 Ω 負載,并具有 50 Ω源阻抗。輸出幅度可在 0.5 至 5.0 V 范圍內(nèi)設(shè)置,輸出失調(diào)范圍可超過 ±2 VDC,以提供幾乎任何邏輯電平(NIM、ECL、PECL、CMOS 等)。在任何輸出幅度下,輸出轉(zhuǎn)換時間均小于2 ns。

 

組合輸出

后面板輸出

可選后面板輸出,支持各種應(yīng)用。選項 1 提供 T05 V邏輯電平的輸出和1個編程延遲(A、B、C、D、E、F、G和H),轉(zhuǎn)換時間小于2 ns。選項30提供相同的輸出,但為100 V、5 ns脈沖,轉(zhuǎn)換時間小于3 ns,適用于高噪聲環(huán)境中的定時分配。選項 5 提供 1 個組合輸出,可在 50 V 邏輯電平下提供 <> 至 <> 個脈沖,轉(zhuǎn)換時間小于 <> ns。每個輸出具有 <> Ω源阻抗。

時基

標準時基的精度為 5 ppm,抖動10-8,適用于許多應(yīng)用??蛇x時基適用于需要更好速率和延遲精度或降低速率和延遲抖動的用戶。

標準時基延遲1 s的時序誤差可高達5 μs,OCXO時基的時序誤差為200 ns,但銣時基的時序誤差僅為500 ps(校準后一年)。

 

時序誤差與延遲

對于短延遲,抖動通常為 20 ps。但是,對于 1 s 延遲,標準時基可以貢獻高達 10 ns 的額外抖動,而可選時基貢獻的額外抖動不到 10 ps。

 

 

快速上升時間模塊

DG645 前面板輸出的轉(zhuǎn)換時間小于 2 ns。SRD1 是一個內(nèi)置于直插式 BNC 連接器中的附件,可將前面板輸出的上升時間縮短到 100 ps 以下。前面板最多可連接五個 SRD1,以減少所有輸出的上升時間。

抖動與延遲

 

 

 

 

 

 

 

DG645規(guī)格

延誤

渠道

4個獨立的脈沖控制位置和寬度。8 個延遲通道可選。
(請參閱下面的輸出選項

范圍

0 到 2000 秒

分辨率

5 頁/秒

準確性

1 ns +(時基誤差×延遲)

抖動 (有效值)
分機三重奏到任何輸出
T0到任何輸出


25 ps + (時基抖動×延遲) 15 ps + (時基抖動×延遲)

觸發(fā)延遲

85 ns(外部觸發(fā)至 T0輸出)

時基

標準晶體

 

抖動

10-8s/s

穩(wěn)定性

2 x 10-620 °C 至 30 °C)

老化

5 頁/分鐘

選項 4 OCXO

 

抖動

10-11s/s

穩(wěn)定性

2 x 10-920 °C 至 30 °C)

老化

0.2 頁/年

選項 5 銣

 

抖動

10-11s/s

穩(wěn)定性

2 x 10-1020 °C 至 30 °C)

老化

0.0005 頁/年

外部輸入

10 MHz ± 10 ppm,正弦>0.5 Vpp,
1 kΩ 阻抗

輸出

10 MHz,2 Vpp 正弦波輸入 50 Ω

外部觸發(fā)器

直流至 1/(100 ns + 最長延遲)。
10 兆赫

門檻

±3.50 伏直流

在上升沿或下降沿觸發(fā)

阻抗

1 兆安電阻 + 15 pF

內(nèi)部速率生成器

觸發(fā)模式

連續(xù)、在線或單次拍攝

100 μHz 至 10 MHz

分辨率

1 微赫茲

準確性

與時基相同

抖動(有效值)

<25 ps (10 MHz/N 觸發(fā)速率) <100 ps (其他觸發(fā)速率)

突發(fā)發(fā)生器

觸發(fā)到個 T0
距離
分辨率


0 至 2000 s
5 ps

脈沖間隔周期
范圍
分辨率


100 ns 至 42.9 s
10 ns

每個突發(fā)的延遲周期

1 至 232- 1

輸出 T0、AB、CD、EF 和 GH)

源阻抗

50 Ω

過渡時間

<2 納秒

過頭

<100 mV + 10 % 脈沖幅度

抵消

±2 V

波幅

0.5 至 5.0 V(電平 + 失調(diào) <6.0 V)

準確性

100 mV + 5 % 脈沖幅度

 

常規(guī)

計算機接口

GPIB (IEEE-488.2)、RS-232 和以太網(wǎng)。所有儀器功能都可以通過接口進行控制。

非易失性存儲器

可以存儲和調(diào)用九組儀器配置。

權(quán)力

<100 W,90 至 264 VAC,47 Hz 至 63 Hz

尺寸

8.5“ × 3.5” × 13“ (WHL)

重量

9磅

保證

一年的零件和人工材料與工藝缺陷

 

 

 

 

輸出選項

 

 

選項 1(延遲輸出)

輸出數(shù)量

8(后面板 BNC)

輸出

T0、A、B、C、D、E、F、G 和 H

源阻抗

50 Ω

過渡時間

<1 納秒

過頭

<100毫伏

水平

+5 V CMOS邏輯

脈沖特性
上升沿 下降沿


編程延遲時最長延遲
25 ns

選項 2(高壓輸出)

輸出數(shù)量

8(后面板 BNC)

輸出

T0、A、B、C、D、E、F、G 和 H

源阻抗

50 Ω

過渡時間

<5 納秒

水平

0 至 30 V 輸入高阻抗,0 至 15 V 輸入 50 Ω(幅度減小 1 %/kHz)

脈沖特性
上升沿 下降沿


在編程延遲
下,上升沿后 100 ns

選項 3(組合輸出)

輸出數(shù)量

8(后面板 BNC)

輸出

T0, AB, CD, EF, GH, (AB+CD), (EF+GH), (AB+CD+EF), (AB+CD+EF+GH)

源阻抗

50 Ω

過渡時間

<1 納秒

過頭

<100 mV + 10 % 脈沖幅度

脈沖特性

 

T0, AB, CD, EF, GH

延遲間隔時間的邏輯高電平

AB+CD), (EF+GH)

由給定通道的邏輯OR產(chǎn)生的兩個脈沖

AB+CD+EF)

由給定通道的邏輯OR產(chǎn)生的三個脈沖

AB+CD+EF+GH)

由給定通道的邏輯OR產(chǎn)生的四個脈沖

選件 SRD1(快速上升時間模塊)

上升時間

<100 頁/秒

秋季時間

<3 納秒

抵消

-0.8 V 至 -1.1 V

波幅

0.5 V 至 5.0 V

負荷

50 Ω

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