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ADS41B49 緩沖低功耗 ADC

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產(chǎn)品型號

品       牌

廠商性質(zhì)其他

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更新時間：2025-01-19 08:45:08瀏覽次數(shù)：46次

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產(chǎn)品簡介

ADS41B49 緩沖低功耗 ADC更新：2023-1-3 16:03:13點(diǎn)擊：產(chǎn)品品牌TI產(chǎn)品型號ADS41B49產(chǎn)品描述采樣率：250 MSPS,支持低輸入時鐘幅度....PDF下載 詢價 申請樣品

詳細(xì)介紹

產(chǎn)品介紹

描述

ADS41Bx9是低功率ADS4xxx模擬 - 數(shù)字轉(zhuǎn)換器（ADC）家族的成員，具有集成模擬輸入緩沖器。這些器件采用創(chuàng)新的設(shè)計(jì)技術(shù)來實(shí)現(xiàn)高動態(tài)性能，并且功耗低。模擬輸入引腳有緩沖器，具有在寬的頻率范圍內(nèi)保持恒定的性能和輸入阻抗的好處。該設(shè)備是非常適合用于多載波，寬頻帶通信應(yīng)用如PA線性化。

該ADS41Bx9具備的功能，如數(shù)字增益和偏移校正。增益選項(xiàng)可用于改善在較低的滿量程輸入范圍SFDR性能，尤其是在高輸入頻率。集成DC偏移校正回路可用于估計(jì)和消除ADC失調(diào)。在較低的采樣速率，ADC自動地在性能沒有損失按比例縮小的功率。

該器件支持雙倍數(shù)據(jù)速率（DDR）低電壓差分信號（LVDS）和并行CMOS數(shù)字輸出接口。在DDR LVDS接口（500 Mbps）的的低數(shù)據(jù)率使得使用低成本的現(xiàn)場可編程門陣列（FPGA）的接收器成為可能。該裝置具有可用于進(jìn)一步降低功耗低擺幅LVDS模式下。在LVDS輸出緩沖器的強(qiáng)度，也可以增加以支持50-Ω差分匹配。

這些器件采用緊湊的VQFN-48封裝，在整個工業(yè)溫度范圍（-40°C至+ 85°C）。

 

特性

●ADS41B49：14位，250 MSPS

●ADS41B29：12位，250 MSPS

●集成高阻抗

●模擬輸入緩沖器：

○ 輸入電容：2 pF的

○ 200-MHz的輸入電阻：3千歐

●采樣率：250 MSPS

●低功耗：

○ 1.8-V模擬電源：180毫瓦

○ 3.3-V緩沖電源：96毫瓦

○ I / O電源：135毫瓦（DDR LVDS）

●高動態(tài)性能：

○ 信噪比：69 dBFS的在170兆赫

○ SFDR：82.5 dBc的在170兆赫

●輸出接口：

○ 雙倍數(shù)據(jù)速率（DDR）LVDS與可編程Swing和強(qiáng)度：

○ 標(biāo)準(zhǔn)Swing：350毫伏

○ 低擺幅：200毫伏

○ 默認(rèn)強(qiáng)度：100Ω終端

○ 2X強(qiáng)度：50Ω終端

○ 1.8-V CMOS并行接口也支持

● 為SNR可編程增益，SFDR權(quán)衡

● 直流偏移校正

● 支持低輸入時鐘幅度

● 封裝：VQFN-48（7毫米×7 MM）

 


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